PEF2256 データシートの表示（PDF） - Infineon Technologies

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PEF2256

Quad E1/T1/J1 Framer and Line Interface Component for Long and Short Haul Applications

Infineon Technologies 

FALC®56

PEF 2256 H/E

List of Tables

Page

Table 1

Table 2

Table 3

Table 4

Table 5

Table 6

Table 7

Table 8

Table 9

Table 10

Table 11

Table 12

Table 13

Table 14

Table 15

Table 16

Table 17

Table 18

Table 19

Table 20

Table 21

Table 22

Table 23

Table 24

Table 25

Table 26

Table 27

Table 28

Table 29

Table 30

Table 31

Table 32

Table 33

Table 34

Table 35

Table 36

Table 37

Table 38

Table 39

Table 40

Table 41

Table 42

Pin Definitions - Microprocessor Interface . . . . . . . . . . . . . . . . . . . . . . 26

Pin Definitions - Line Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

Pin Definitions - Clock Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

Pin Definitions - System Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

Miscellaneous Pin Definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

Data Bus Access (16-Bit Intel Mode) . . . . . . . . . . . . . . . . . . . . . . . . . . 51

Data Bus Access (16-Bit Motorola Mode) . . . . . . . . . . . . . . . . . . . . . . 51

Selectable Bus and Microprocessor Interface Configuration . . . . . . . . 52

TAP Controller Instruction Codes . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57

Decoupling Capacitor Parameters . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61

RCLK Output Selection (E1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65

Recommended Receiver Configuration Values (E1) . . . . . . . . . . . . . . 66

External Component Recommendations (Monitoring) . . . . . . . . . . . . . 67

System Clocking (E1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 71

Output Jitter (E1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

Receive Buffer Operating Modes (E1) . . . . . . . . . . . . . . . . . . . . . . . . . 75

Allocation of Bits 1 to 8 of Time Slot 0 (E1) . . . . . . . . . . . . . . . . . . . . . 83

Transmit Transparent Mode (Doubleframe E1) . . . . . . . . . . . . . . . . . . 84

CRC-Multiframe Structure (E1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86

Transmit Transparent Mode (CRC Multiframe E1) . . . . . . . . . . . . . . . 87

Summary of Alarm Detection and Release (E1) . . . . . . . . . . . . . . . . . 93

Recommended Transmitter Configuration Values (E1) . . . . . . . . . . . . 98

Transmit Buffer Operating Modes (E1) . . . . . . . . . . . . . . . . . . . . . . . 101

System Clocking and Data Rates (E1) . . . . . . . . . . . . . . . . . . . . . . . 105

Time Slot Assigner HDLC Channel 1 (E1) . . . . . . . . . . . . . . . . . . . . . 116

RCLK Output Selection (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 124

Recommended Receiver Configuration Values (T1/J1). . . . . . . . . . . 125

External Component Recommendations (Monitoring) . . . . . . . . . . . . 126

System Clocking (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130

Output Jitter (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 133

Channel Translation Modes (DS1/J1) . . . . . . . . . . . . . . . . . . . . . . . . 135

Receive Buffer Operation Modes (T1/J1) . . . . . . . . . . . . . . . . . . . . . 136

Resynchronization Timing (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . . . . . 144

4-Frame Multiframe Structure (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . . 146

12-Frame Multiframe Structure (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . 147

Extended Superframe Structure (F24, ESF; T1/J1) . . . . . . . . . . . . . . 148

72-Frame Multiframe Structure (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . 152

Summary Frame Recover/Out of Frame Conditions (T1/J1) . . . . . . . 154

Summary of Alarm Detection and Release (T1/J1) . . . . . . . . . . . . . . 155

Recommended Transmitter Configuration Values (T1/J1). . . . . . . . . 160

Transmit Buffer Operating Modes (T1/J1) . . . . . . . . . . . . . . . . . . . . . 165

Pulse Shaper Programming (T1/J1) . . . . . . . . . . . . . . . . . . . . . . . . . 165

User’s Manual

13

Hardware Description

DS1.1, 2003-10-23

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